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当我们做后仿时我们究竟在仿些什么
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当我们做后仿时我们究竟在仿些什么(四)
#验证
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芯片后仿及SDF反标
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芯片后仿
#前端
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芯片后仿
全栈芯片工程师
综合网表带SDF前仿真
#验证
#后仿
网表布局布线前,未进行时钟树综合,保持时间尚未修复,此时我们也可以由DC/PT写出SDF文件进行综合网表仿真,但是此时的SDF文件中的保持时间为假的,可能导致出发器违例造成X态传播,造成仿真失败。本文介绍了两种方法来解决这个问题。
全栈芯片工程师